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FPGA设计时序分析三、恢复/去除时间

2023-07-29 15:16 作者:行中悟_悟中行  | 我要投稿

一、背景说明

    恢复时间recovery和去除时间removal和setup、holdup类型,不同点是数据信号为控制信号,如复位,清零,使能信号,更多的是异步的复位信号,并且是针对复位信号取消时的上升沿。

    recovery: 复位取消信号需在时钟信号到达之前的recovery时间内稳定下来,保证复位完全释放

    removal: 复位消信号需在时钟信号到达后保持至少removal时间,保证复位信号有效


二、工程设计

    目前寄存器都采用异步复位,同步释放,复位可以不依靠时钟,实现简单,同时可以稳定释放复位信号,不出现亚稳态问题

2.1 工程代码

2.2 综合结果

    在3个FDCE的CLR端口前面都插入了LUT1,作用是作为反相器,因为FDCE的CLR是高电平有效,源码设计中为低电平进行有效复位。复位信号rst是经过两拍之后在out_reg中使用。


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